基于FPGA高速線陣CCD的驅(qū)動電路設(shè)計
所屬分類：參考設(shè)計
上傳者：aet
文檔大?。?span>396 K
標(biāo)簽： FPGA
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文檔介紹：線陣CCD的驅(qū)動電路設(shè)計是決定CCD成像質(zhì)量的關(guān)鍵技術(shù)之一。在對TCD1706D線陣CCD驅(qū)動時序分析的基礎(chǔ)上,，利用FPGA實現(xiàn)了線陣CCD的工作頻率為10 MHz的驅(qū)動電路設(shè)計,。利用Quartus II軟件自帶的PLL IP核生成系統(tǒng)工作頻率，通過Verilog語言對硬件電路進(jìn)行描述,，采用Moore有限狀態(tài)機(jī)實現(xiàn)驅(qū)動信號之間的相位關(guān)系,。通過Quartus II軟件平臺，對設(shè)計的時序電路進(jìn)行仿真,，并在示波器中顯示了直徑為0.16 mm的漆包線的成像波形,。實驗結(jié)果表明，該方法能夠滿足TCD1706D線陣CCD工作頻率為10 MHz的要求,。
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