基于FPGA的AVS視頻解碼芯片驗證平臺設(shè)計
所屬分類：參考設(shè)計
上傳者：aet
文檔大?。?span>404 K
標(biāo)簽： FPGA
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文檔介紹：針對AVS視頻解碼芯片仿真和驗證的要求,，提出了基于FPGA的驗證平臺框架,。該驗證平臺主要用于對AVS解碼芯片進(jìn)行硬件模塊的驗證,，從而為整個視頻解碼芯片的開發(fā)提供可靠的依據(jù),。該平臺基于Nios II軟核處理器,，可使軟件模塊和硬件模塊在一個平臺下真正實現(xiàn)軟硬件協(xié)同工作,?；谠撈脚_實現(xiàn)了多個硬件模塊和AVS視頻解碼芯片的驗證，其結(jié)果證明了該驗證平臺的正確性和可靠性,。
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