基于FPGA+DSP的雷達信號處理模塊的設(shè)計 | |
所屬分類:參考設(shè)計 | |
上傳者:aet | |
文檔大?。?span>276 K | |
所需積分:0分積分不夠怎么辦,? | |
文檔介紹:針對現(xiàn)代機載雷達信號處理系統(tǒng)的通用性、靈活性要求,,提出了一種基于DSP+FPGA的雷達信號處理系統(tǒng)的設(shè)計方法,。以機載PD雷達信號處理系統(tǒng)為例,給出了測試結(jié)果,,完成的系統(tǒng)具有高可靠性和實時性,。 | |
現(xiàn)在下載 | |
VIP會員,AET專家下載不扣分;重復(fù)下載不扣分,,本人上傳資源不扣分,。 |
Copyright ? 2005-2024 華北計算機系統(tǒng)工程研究所版權(quán)所有 京ICP備10017138號-2