基于FPGA的并行可變長解碼器的實(shí)現(xiàn)
所屬分類：技術(shù)論文
上傳者：aet
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文檔介紹：介紹了一種采用并行方式構(gòu)建的多符號可變長碼解碼器,。該解碼器通過增加結(jié)構(gòu)的復(fù)雜性和對硬件資源的占用,，換取可變長碼解碼的高吞吐量,。這種結(jié)構(gòu)突破了可變長碼碼字之間的前向依賴性,，可并行偵測出Buffer中的所有可能的碼字,。采用FPGA實(shí)現(xiàn)了這種結(jié)構(gòu)。
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