時(shí)延估計(jì)算法的FPGA實(shí)現(xiàn) | |
所屬分類:技術(shù)論文 | |
上傳者:aet | |
文檔大?。?span>1966 K | |
所需積分:0分積分不夠怎么辦,? | |
文檔介紹:時(shí)延估計(jì)是雷達(dá)、聲納等領(lǐng)域經(jīng)常遇到的一個(gè)問題,,提出了利用相關(guān)計(jì)算法實(shí)現(xiàn)時(shí)延估計(jì),,并通過互譜插值提高估計(jì)精度,。結(jié)合FPGA器件特性,運(yùn)用VHDL語言編程,,實(shí)現(xiàn)了整個(gè)相關(guān)算法,。利用QuartusⅡ和Matlab軟件進(jìn)行了聯(lián)合仿真,結(jié)果證明了設(shè)計(jì)的正確性,。 | |
現(xiàn)在下載 | |
VIP會(huì)員,,AET專家下載不扣分;重復(fù)下載不扣分,,本人上傳資源不扣分。 |
Copyright ? 2005-2024 華北計(jì)算機(jī)系統(tǒng)工程研究所版權(quán)所有 京ICP備10017138號(hào)-2