| LOG算子在FPGA中的實(shí)現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大?。?span>238 K | |
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| 文檔介紹：介紹了一種高斯—拉普拉斯(LOG)算子在FPGA中的實(shí)現(xiàn)方案，并通過(guò)對(duì)一幅bmp圖像的處理，論證了在FPGA中實(shí)現(xiàn)的LOG算子的圖像增強(qiáng)效果,。 | |
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