HDLC協(xié)議控制器IP核的設計與實現(xiàn)
王雅榮,，鮑民權(quán),，邱智亮
摘要： 介紹了HDLC協(xié)議控制器的IP核方案及實現(xiàn)方法，分別對發(fā)送和接收模塊進行了分析,，給出了仿真波形圖,。該設計采用Verilog HDL語言進行描述,，用ModelSim SE 6.0進行了功能仿真。
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摘 要： 介紹了HDLC協(xié)議" title="HDLC協(xié)議">HDLC協(xié)議控制器的IP核" title="IP核">IP核方案及實現(xiàn)方法,，分別對發(fā)送和接收模塊進行了分析,，給出了仿真波形圖。該設計采用Verilog HDL語言" title="Verilog HDL語言">Verilog HDL語言進行描述，用ModelSim SE 6.0進行了功能仿真,。
關(guān)鍵詞： HDLC協(xié)議 IP核 Verilog HDL語言
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